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  1. 1
    Implementación de controlador SDRAM para GPU THEIA

    Implementación de controlador SDRAM para GPU THEIA por Ruh Guevara, Manuel, 1989-

    Publicado 2014
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  2. 2
    Sintetizador y visualizador de circuitos digitales parte 2

    Sintetizador y visualizador de circuitos digitales parte 2 por Gairaud Benavides, Julián Alberto, 1992-

    Publicado 2014
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  3. 3
    Sintetizador y visualizador de circuitos digitales en tiempo real parte 1

    Sintetizador y visualizador de circuitos digitales en tiempo real parte 1 por Araya Carballo, Luis Enrique, 1992-

    Publicado 2014
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  4. 4
    Diseño de un cache de texturas para el GPU Theia

    Diseño de un cache de texturas para el GPU Theia por Rivera Valverde, Francisco

    Publicado 2011
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  5. 5
    Arbitraje en el bus del sistema multiprocesador, GPU Theia

    Arbitraje en el bus del sistema multiprocesador, GPU Theia por Bustos Torres, Hernán

    Publicado 2011
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  6. 6
    Extensión de blender para la generación de archivos de entrada de simulación de escenas tridimensionales del GPU theia

    Extensión de blender para la generación de archivos de entrada de simulación de escenas tridimensionales del GPU theia por Díaz Bolaños, Daniel Antonio

    Publicado 2011
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  7. 7
    Implementación de una macro celda de interfaz para transmisión y recepción de datos compatible con el estandar de bus de serie universal 2.0

    Implementación de una macro celda de interfaz para transmisión y recepción de datos compatible con el estandar de bus de serie universal 2.0 por Alfaro Jiménez, José Alberto

    Publicado 2009
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  8. 8
    Estudio y evaluación de algoritmos de encriptación para la protección de datos para su implementación usando lenguajes de descripción de hardware

    Estudio y evaluación de algoritmos de encriptación para la protección de datos para su implementación usando lenguajes de descripción de hardware por Vargas Vargas, Laura

    Publicado 2009
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  9. 9
    Compilador y simulador para la CPUCR de 8 bits

    Compilador y simulador para la CPUCR de 8 bits por Villalobos Ortega, Edgar

    Publicado 2009
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  10. 10
    Procedimiento de diseño e implementación de circuitos digitales utilizando herrramientas EDA de código abierto

    Procedimiento de diseño e implementación de circuitos digitales utilizando herrramientas EDA de código abierto por Castro Jiménez, Gerardo

    Publicado 2008
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  11. 11
    Implementación de verilog de Unidad de generación de rayos para GPU Theia

    Implementación de verilog de Unidad de generación de rayos para GPU Theia por Vargas Amador, Josué David, 1993-

    Publicado 2015
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  12. 12
    Implementación y análisis de algoritmos criptográficos en un FPGA

    Implementación y análisis de algoritmos criptográficos en un FPGA por León Torres, Alejandro, 1993-

    Publicado 2015
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  13. 13
    Diseño de los módulos en Verilog de un decodificador de audio del formato Ogg Vorbis

    Diseño de los módulos en Verilog de un decodificador de audio del formato Ogg Vorbis por Aguilar Romero, Sergio

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  14. 14
    Generación de un modelo sintetizable en compuertas estándar para la CPUCR

    Generación de un modelo sintetizable en compuertas estándar para la CPUCR por Alvarado Pacheco, Warren

    Publicado 2005
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  15. 15
    Modelado y síntesis de una CPUCR multiregistro

    Modelado y síntesis de una CPUCR multiregistro por Salazar A., Eduardo

    Publicado 2004
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  16. 16
    Desarrollo de un modulo de UART para la CPUCR

    Desarrollo de un modulo de UART para la CPUCR por Herrera Rojas, Juan Carlos

    Publicado 2003
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  17. 17
    Modelado y síntesis de la CPUCR

    Modelado y síntesis de la CPUCR por Arellano Cartin, Roberto

    Publicado 2003
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  18. 18
    Depuración del diseño lógico de la CPUCR

    Depuración del diseño lógico de la CPUCR por Aimé Gamboa, Frantz

    Publicado 2001
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  19. 19
    Diseño y verificación del controlador e interfaz de sonido para el proyecto abierto papiGB

    Diseño y verificación del controlador e interfaz de sonido para el proyecto abierto papiGB por Torres Umaña Marco Antonio, 1992-

    Publicado 2016
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