Implementación de una macro celda de interfaz para transmisión y recepción de datos compatible con el estandar de bus de serie universal 2.0

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Manylion Llyfryddiaeth
Prif Awdur:	Alfaro Jiménez, José Alberto
Fformat:	Llyfr
Cyhoeddwyd:	[San José, Costa Rica] 2009
Pynciau:	VERILOG (LENGUAJE PARA DESCRIPCION DE EQUIPO DE COMPUTACION) > USB (BUS PARA COMPUTADORAS)
Tagiau:	Ychwanegu Tag Dim Tagiau, Byddwch y cyntaf i dagio'r cofnod hwn!

Eitemau Tebyg

Arbitraje en el bus del sistema multiprocesador, GPU Theia
gan: Bustos Torres, Hernán
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